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VeriDebug: A Unified Large Language Model for Verilog Debugging Based on Contrastive Embeddings and Guided Correction
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原文英文，约100词，阅读约需1分钟。
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内容提要
本研究提出了VeriDebug系统，旨在解决大型语言模型在Verilog调试中的不足。该系统通过对比表示和引导纠正机制，能够自动检测和修复错误，准确率达到64.7%，优于现有模型。
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关键要点
- 本研究提出了VeriDebug系统，旨在解决大型语言模型在Verilog调试中的不足。
- VeriDebug系统通过对比表示和引导纠正机制，能够自动检测和修复错误。
- VeriDebug的错误修复准确率达到64.7%，优于现有的开源模型和闭源模型。
- 该系统通过共享参数空间统一了错误检测和修复过程，展现了在传统调试方法上的优势。
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